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萊迪思半導(dǎo)體與Helion合作推出基于FPGA的新一代攝像頭設(shè)計解決方案
近日，萊迪思半導(dǎo)體公司宣布攜手Helion推出多款基于FPGA的新一代攝像頭設(shè)計解決方案。這項開發(fā)是運用低成本、低密度FPGA加速先進的攝像頭設(shè)計的。
2015-02-12
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美高森美為SmartFusion2 SoC FPGA和IGLOO2 FPGA 器件加入物理不可克隆功能
近日，美高森美公司宣布為其旗艦SmartFusion?2 SoC FPGA和IGLOO?2 FPGA 器件的領(lǐng)先網(wǎng)絡(luò)安全功能組合增加物理不可克隆功能。此舉增強了SmartFusion2 SoC FPGA和IGLOO2 FPGA器件功能，同時進一步提升在FPGA領(lǐng)域的網(wǎng)絡(luò)安全領(lǐng)導(dǎo)地位。
2015-02-11
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對比分析“一母同胞”的CPLD與FPGA不同之處
可編程邏輯器件在數(shù)字系統(tǒng)的發(fā)展史中可以說是最亮的一筆。PLD能夠完成任何數(shù)字器件的功能，用PLD來開發(fā)數(shù)字電路能夠減少PCB面積，提高系統(tǒng)的可靠性，而且還大大減少了設(shè)計時間。由PLD延伸出的FPGA和CPLD都是可編程邏輯器件。
2015-02-07
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FPGA激光器驅(qū)動怎么辦？電路設(shè)計指南幫你忙
本文設(shè)計了一種半導(dǎo)體激光器驅(qū)動電路，重點介紹了利用FPGA 實現(xiàn)DDS 的方法。利用QuartusII 軟件進行在線仿真，減少了后期進行綜合試驗的錯誤率。在完成系統(tǒng)的核心部分設(shè)計之后，對硬件電路的設(shè)計進行了詳細的討論，感興趣的童鞋可以瞧瞧！
2015-02-07
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低電壓電路設(shè)計分享，FPGA成功的關(guān)鍵步驟
要想獲得成功的FPGA的電路板，最關(guān)鍵的步驟就是需要低電壓電路，并且不止一個，行業(yè)普遍的都是四到五個，那么如何設(shè)計這四至五個不同的低壓電源對不同元件供電電路呢？
2015-02-06
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萊迪思半導(dǎo)體公司宣布iCE系列器件出貨量超2.5億片
近日，萊迪思半導(dǎo)體公司宣布可編程產(chǎn)品iCE系列器件上市三年出貨量超過2.5億片。越來越多的移動設(shè)備集成iCE系列FPGA，使得制造商對于iCE系列FPGA的需求持續(xù)增長。
2015-02-05
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如何實現(xiàn)高效并行的實時上采樣？FPGA獻計
采集模擬信號的樣本叫采樣。一般情況下，采樣指的是下采樣，就是抽取信號。上采樣和下采樣都是對數(shù)字信號的重采過程。而上采樣是下采樣的逆過程，同時也是增取樣或內(nèi)插的過程。本文詳細介紹了使用FPGA來實現(xiàn)高效并行的實時上采樣過程。
2015-02-05
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萊迪思半導(dǎo)體推出的新一代iCE40 UltraLite器件 可為OEM廠商豐富移動設(shè)備的功能
近日，萊迪思半導(dǎo)體公司宣布推出新一代iCE40 UltraLite器件，可幫助制造商將獨一無二、極具吸引力的功能添加到最新的移動設(shè)備中，并加速其產(chǎn)品上市進程。iCE40 UltraLite FPGA是適用于消費類移動設(shè)備和工業(yè)手持設(shè)備，業(yè)界尺寸最小、功耗最低的可編程解決方案。
2015-02-05
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如果FPGA設(shè)計中出現(xiàn)時序違規(guī)，要怎么辦？
前面小編為大家講到《時序約束的一些經(jīng)驗》，這一節(jié)中將談?wù)撎砑蛹s束后進行綜合，如果出現(xiàn)時序違規(guī)，會是哪類情況以及該如何去解決。想學(xué)習(xí)這方面知識的童鞋可千萬別錯過，不然后悔別找我??！
2015-02-04
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經(jīng)典電路：FPGA電機測速系統(tǒng)如何工作？
本次設(shè)計是基于FPGA 的電機測速系統(tǒng)設(shè)計，利用的是Altera 公司開發(fā)的Quartus II 軟件作為設(shè)計平臺，可以在FPGA 開發(fā)板上實現(xiàn)測量由傳感器轉(zhuǎn)換得到的脈沖信號，并且通過計算得到電機轉(zhuǎn)速值。
2015-02-04
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菜鳥升級必備：通透了解FPGA設(shè)計流程
初學(xué)者對于FPGA的設(shè)計流程總是束手無策，可能會感覺FPGA的設(shè)計流程冗長繁雜，無從下手。通過EDA設(shè)計工具掌握FPGA設(shè)計流程，這些都不是問題。
2015-01-31
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網(wǎng)友分享：時序約束的一些經(jīng)驗之談
如果設(shè)計的電路只是提供給NIOSII在FPGA內(nèi)調(diào)用，沒有外部器件的相關(guān)延時信息，該怎么約束輸入輸出呢？ 針對一個這位網(wǎng)友給出了時序約束的一些經(jīng)驗之談，分享給大家。
2015-01-29
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